सत्य तालिका इनपुट
0 और 1 के बीच टॉगल करने के लिए आउटपुट सेल पर क्लिक करें।
| A | B | C | बाहर |
|---|
उत्पन्न तर्क सर्किट
वर्कफ़्लो अवलोकन
यह वर्कफ़्लो आउटपुट-बिट व्यवहार को सरलीकृत बूलियन अभिव्यक्ति और त्वरित कार्यान्वयन के लिए एक व्यावहारिक गेट-स्टेज योजना में परिवर्तित करता है।
मंच 1
बूलियन रिडक्शन पाइपलाइन
उपकरण चर और बिट लंबाई को मान्य करता है, न्यूनतम शब्द निकालता है, और अभिव्यक्ति को कम करता है ताकि अंतिम समीकरण को लागू करना आसान हो।
परिवर्तनीय गणना किसी भी कटौती शुरू होने से पहले आवश्यक सत्य-सारणी पंक्तियों को निर्धारित करती है।
| इनपुट नियम | यह क्यों मायने रखता है | आउटपुट |
|---|---|---|
| 1-4 चर | प्रबंधनीय सत्य-तालिका चौड़ाई को परिभाषित करता है | अपेक्षित बिट गिनती |
| बिट-लंबाई मिलान | अमान्य पंक्ति व्याख्या को रोकता है | विश्वसनीय मिन्टर्म सेट |
| प्रधान कमी | अनावश्यक शब्दों को हटा देता है | सरलीकृत अभिव्यक्ति |
मंच 2
गेट-स्तरीय योजना और सत्यापन
सरलीकरण के बाद, उपकरण गेट चरणों का अनुमान लगाता है और NOT, AND, और OR संरचना के लिए एक कॉम्पैक्ट कार्यान्वयन पथ प्रदान करता है।
केवल आवश्यक पूरक अक्षर ही NOT चरणों के माध्यम से भेजे जाते हैं।
| गेट स्टेज | प्रयोजन | डिज़ाइन लाभ |
|---|---|---|
| मंच नहीं | पूरक शाब्दिक उत्पन्न करें | वायरिंग की अस्पष्टता कम हो जाती है |
| तथा मंच | प्रत्येक उत्पाद शब्द का निर्माण करें | तर्क को मॉड्यूलर रखता है |
| या मंच | टर्म आउटपुट मर्ज करें | एफ आउटपुट से सीधे मेल खाता है |
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